7英文翻译
发布时间:2011-06-24 来源:文档文库
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数字频率计的介绍
数字频率计是通信设备、音、视频等科研生产领域不可缺少的测量仪器。采用Verilog HDL编程设计实现的数字频率计,除被测信号的整形部分、键输入部分和数码显示部分外,其余全部在一片FPGA芯片上实现。整个系统非常精简,且具有灵活的现场可更改性。
1 等精度测频原理
频率的测量方法主要分为2 种方法: (1 直接测量法, 即在一定的闸门时间内测量被测信号的脉冲个数。 (2 间接测量法, 例如周期测频法、V F 转换法等。间接测频法仅适用测量低频信号。
基于传统测频原理的频率计的测量精度将随被测信号频率的下降而降低, 在实用中有较大的局限性, 而等精度频率计不但具有较高的测量精度, 而且在整个频率区域能保持恒定的测试精度。频率测量方法的主要测量预置门控信号GATE是由单片机发出,GATE的时间宽度对测频精度影响较少,可以在较大的范围内选择,只要FPGA中32 b计数器在计100 M信号不溢出都行,根据理论计算GATE的时间宽度Tc可以大于42.94 s,但是由于单片机的数据处理能力限制,实际的时间宽度较少,一般可在10~0.1 s间选择,即在高频段时,闸门时间较短;低频时闸门时间较长。这样闸门时间宽度Tc依据被测频率的大小自动调整测频,从而实现量程的自动转换,扩大了测频的量程范围;实现了全范围等精度测量,减少了低频测量的误差。
本设计频率测量方法的主要测量控制框图如图1 所示。图1 中预置门控信号GA TE 是由单片机发出, GA TE的时间宽度对测频精度影响较少, 可以在较大的范围内选择, 只要FPGA 中32 b 计数器在计100M 信号不溢出都行, 根据理论计算GA TE 的时间宽度T c 可以大于42194s, 但是由于单片机的数据处理能力限制, 实际的时间宽度较少, 一般可在10~ 011 s 间选择, 即在高频段时, 闸门时间较短; 低频时闸门时间较长。这样闸门时间宽度T c 依据被测频率的大1
小自动调整测频, 从而实现量程的自动转换, 扩大了测频的量程范围; 实现了全范围等精度测量, 减少了低频测量的误差。
2 频率计的实现
等精度测频的实现方法 。可简化为CNT1和CNT2是两个可控计数器,标准频率(f 信号从CN F1的时钟输入端cI K输入,经整形后的被测信号(f 从CNT2的时钟输入端cI K输入。每个计数器中的CEN输入端为使能端,用来控制计数器计数。当预置闸门信号为高电平(预置时间开始时。被测信号的上升沿通过D触发器的输入端,同时启动两个汁数器计数;同样,当预置闸门信号为低电平(预置时间结束时,被测信号的上升沿通过D触发器的输出端,使计数器停止计数。
3 频率计的位数及相关指标
位数:同时最多能显示的数字位数。平常计数式的8位频率计只有几百元就可买到。对于高精度的测量,9位刚刚开始,11位算中等,13位才能算比较高级。
溢出位:把溢出位算进去的总等效位。有些频率计带有溢出功能,即把最高位溢出不显示而只显示后面的位,以便达到提高位数的目的。这里个别指标是估计值。
速度:即每秒能出多少位。有了高位数的但测量特别慢也失去了意义。平常计数式的8位频率计,测量10MHz信号、1秒闸门能得到10,000,000Hz,这实